パワー半導体KGDテスター
PB6600
SiC KGD テムテスト選別システム
特徴
装置に分離設計を採用し、高い拡張性を実現
ローディングとアンローディング部分の処理装置はテスト部分から切り離され、拡張性が非常に高い
マルチチャンネルの並列テスト
最大で6つのテストステーションに対応し、各テストステーションは異なるテスト条件とテスト項目を同時に実施可能
動的および静的パラメトリック・テストに対応
2000V/600A静的テストと1200V/2000A動的テストに対応
正確なテスト結果
室温 ～200 ℃、精度＜±3℃、分解能 0.1℃
Hard Dockingを採用
システム漂遊インダクタンス≤50nH
窒素ガス圧力検知
プローブカードは密閉チャンバー設計を採用し、アークの発生を防止
UPHは1400pcsを超える
単一テストステーションのテスト時間≤1秒
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パラメータ |
仕様 |
备注 |
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基本パラメータ |
適用裸ダイサイズ |
2.5*2.5mm-8*8mm |
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適用裸ダイの厚さ |
100-400um |
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総合搬送精度 |
±30um |
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控温能力 |
温度範囲 |
室温~185℃ |
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温度分解能 |
0.1℃ |
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温度安定性 |
≤±3℃ |
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視覚検査能力 |
外観検査精度 |
≥12um |
要求欠陥のイメージンググレースケールと周囲のコントラストが40 以上を超える |
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欠陥検出プロジェクト |
正面/背面：傷、汚れ、異物、爆点、欠け、崩れ |
可支持正面划痕（長さ>30um、幅>12um）、汚れ（30um 以上）、異物（30um）、炸点（30um）などの欠陥検出、支持背面崩れ（12um）、欠け（12um）汚れ（30um）、划痕（長さ>30um、幅>12um）、残留接着剤（30um）などの欠陥検出、具体的な欠陥閾値は顧客の実際の製品プロセスに基づいて定義する必要があります。ソフトウェアは欠陥の位置をマークし、欠陥の画像を保存できます |
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側面：崩れた端 |
支持側面切断黒線（幅>12um、長さ>30um）、崩れ（深さ>30um、幅>20um）などの欠陥検出 |
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安定性 |
MTBF |
>168H |
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MTBA |
>2H |
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MTTA |
5 min |
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MTTR |
< 30 min |
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掉料率 |
≤0.01% |
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碎片率: 破片率 |
≤0.01% |
搬送による |
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針痕の深さ |
≤2um |
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ドレイン極開ルビン |
≤2Ω |
TiNiAg材質 |
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テスト効率 |
単die |
≥1400 |
テスト時間≤1s |
その他おすすめ
LDのバーンインテストは、LDの信頼性を確保するための重要なテスト手法として産業用プロセスに広く活用されています。COC、COSまたはDIEのバーンインテストを通じて、LD生産プロセスによる欠陥を早期に発見し、後工程でのLDの故障や不良を防止できます。LDスクリーニングによる廃却損失の低減、サイクルタイムの向上、工程内のムダを発見することでチップ生産の効率を大幅に向上させます。聯訊儀器はDIEからCOCまで、高温から-40℃の低温まで、トータルソリューションを提供し、多様なお客様の要件にお応えします。
Details
半導体のフロントエンドテストは主にウェハーの加工プロセスで実施されます。これにより、ウェハー製造プロセスの各工程の指標、閾値、パラメータ要件などは設計の目標値を満たしているかを確認し、良品率に影響を与える欠陥を早期に発見することができます。
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